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media: qcom: camss: Add support for CSID 690
Add support for CSID 690 found on lemans(sa8775p) soc, This is different from csid 780 w.r.t few register offsets and bit-fields. Signed-off-by: Suresh Vankadara <quic_svankada@quicinc.com> Signed-off-by: Vikram Sharma <quic_vikramsa@quicinc.com> Reviewed-by: Bryan O'Donoghue <bryan.odonoghue@linaro.org> Signed-off-by: Bryan O'Donoghue <bod@kernel.org> Signed-off-by: Hans Verkuil <hverkuil+cisco@kernel.org>
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Vikram Sharma
committed by
Mauro Carvalho Chehab
Mauro Carvalho Chehab
parent
7803b63a16
commit
ed03e99de0
@@ -45,8 +45,11 @@
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#define CSID_CSI2_RX_IRQ_CLEAR 0xA4
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#define CSID_CSI2_RX_IRQ_SET 0xA8
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#define IS_CSID_690(csid) (csid->camss->res->version == CAMSS_8775P)
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#define CSID_BUF_DONE_IRQ_STATUS 0x8C
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||||
#define BUF_DONE_IRQ_STATUS_RDI_OFFSET (csid_is_lite(csid) ? 1 : 14)
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||||
#define BUF_DONE_IRQ_STATUS_RDI_OFFSET (csid_is_lite(csid) ?\
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1 : (IS_CSID_690(csid) ?\
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13 : 14))
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#define CSID_BUF_DONE_IRQ_MASK 0x90
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#define CSID_BUF_DONE_IRQ_CLEAR 0x94
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#define CSID_BUF_DONE_IRQ_SET 0x98
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@@ -59,6 +62,7 @@
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#define CSID_CSI2_RX_CFG0 0x200
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#define CSI2_RX_CFG0_NUM_ACTIVE_LANES 0
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#define CSI2_RX_CFG0_VC_MODE 3
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#define CSI2_RX_CFG0_DL0_INPUT_SEL 4
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#define CSI2_RX_CFG0_PHY_NUM_SEL 20
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@@ -66,7 +70,9 @@
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#define CSI2_RX_CFG1_ECC_CORRECTION_EN BIT(0)
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#define CSI2_RX_CFG1_VC_MODE BIT(2)
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#define CSID_RDI_CFG0(rdi) (0x500 + 0x100 * (rdi))
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||||
#define CSID_RDI_CFG0(rdi) (csid_is_lite(csid) && IS_CSID_690(csid) ?\
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||||
(0x300 + 0x100 * (rdi)) :\
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||||
(0x500 + 0x100 * (rdi)))
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#define RDI_CFG0_TIMESTAMP_EN BIT(6)
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#define RDI_CFG0_TIMESTAMP_STB_SEL BIT(8)
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||||
#define RDI_CFG0_DECODE_FORMAT 12
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@@ -75,10 +81,14 @@
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#define RDI_CFG0_DT_ID 27
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||||
#define RDI_CFG0_EN BIT(31)
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||||
#define CSID_RDI_CTRL(rdi) (0x504 + 0x100 * (rdi))
|
||||
#define CSID_RDI_CTRL(rdi) (csid_is_lite(csid) && IS_CSID_690(csid) ?\
|
||||
(0x304 + 0x100 * (rdi)) :\
|
||||
(0x504 + 0x100 * (rdi)))
|
||||
#define RDI_CTRL_START_CMD BIT(0)
|
||||
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||||
#define CSID_RDI_CFG1(rdi) (0x510 + 0x100 * (rdi))
|
||||
#define CSID_RDI_CFG1(rdi) (csid_is_lite(csid) && IS_CSID_690(csid) ?\
|
||||
(0x310 + 0x100 * (rdi)) :\
|
||||
(0x510 + 0x100 * (rdi)))
|
||||
#define RDI_CFG1_DROP_H_EN BIT(5)
|
||||
#define RDI_CFG1_DROP_V_EN BIT(6)
|
||||
#define RDI_CFG1_CROP_H_EN BIT(7)
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||||
@@ -86,9 +96,12 @@
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||||
#define RDI_CFG1_PIX_STORE BIT(10)
|
||||
#define RDI_CFG1_PACKING_FORMAT_MIPI BIT(15)
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||||
#define CSID_RDI_IRQ_SUBSAMPLE_PATTERN(rdi) (0x548 + 0x100 * (rdi))
|
||||
#define CSID_RDI_IRQ_SUBSAMPLE_PERIOD(rdi) (0x54C + 0x100 * (rdi))
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||||
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||||
#define CSID_RDI_IRQ_SUBSAMPLE_PATTERN(rdi) (csid_is_lite(csid) && IS_CSID_690(csid) ?\
|
||||
(0x348 + 0x100 * (rdi)) :\
|
||||
(0x548 + 0x100 * (rdi)))
|
||||
#define CSID_RDI_IRQ_SUBSAMPLE_PERIOD(rdi) (csid_is_lite(csid) && IS_CSID_690(csid) ?\
|
||||
(0x34C + 0x100 * (rdi)) :\
|
||||
(0x54C + 0x100 * (rdi)))
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||||
#define CSI2_RX_CFG0_PHY_SEL_BASE_IDX 1
|
||||
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||||
static void __csid_configure_rx(struct csid_device *csid,
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||||
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||||
@@ -2688,6 +2688,139 @@ static const struct camss_subdev_resources csiphy_res_8775p[] = {
|
||||
},
|
||||
};
|
||||
|
||||
static const struct camss_subdev_resources csid_res_8775p[] = {
|
||||
/* CSID0 */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "csid", "csiphy_rx"},
|
||||
.clock_rate = {
|
||||
{ 400000000, 400000000},
|
||||
{ 400000000, 400000000}
|
||||
},
|
||||
.reg = { "csid0" },
|
||||
.interrupt = { "csid0" },
|
||||
.csid = {
|
||||
.is_lite = false,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
/* CSID1 */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "csid", "csiphy_rx"},
|
||||
.clock_rate = {
|
||||
{ 400000000, 400000000},
|
||||
{ 400000000, 400000000}
|
||||
},
|
||||
.reg = { "csid1" },
|
||||
.interrupt = { "csid1" },
|
||||
.csid = {
|
||||
.is_lite = false,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
|
||||
/* CSID2 (lite) */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "cpas_vfe_lite", "vfe_lite_ahb",
|
||||
"vfe_lite_csid", "vfe_lite_cphy_rx",
|
||||
"vfe_lite"},
|
||||
.clock_rate = {
|
||||
{ 0, 0, 400000000, 400000000, 0},
|
||||
{ 0, 0, 400000000, 480000000, 0}
|
||||
},
|
||||
.reg = { "csid_lite0" },
|
||||
.interrupt = { "csid_lite0" },
|
||||
.csid = {
|
||||
.is_lite = true,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
/* CSID3 (lite) */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "cpas_vfe_lite", "vfe_lite_ahb",
|
||||
"vfe_lite_csid", "vfe_lite_cphy_rx",
|
||||
"vfe_lite"},
|
||||
.clock_rate = {
|
||||
{ 0, 0, 400000000, 400000000, 0},
|
||||
{ 0, 0, 400000000, 480000000, 0}
|
||||
},
|
||||
.reg = { "csid_lite1" },
|
||||
.interrupt = { "csid_lite1" },
|
||||
.csid = {
|
||||
.is_lite = true,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
/* CSID4 (lite) */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "cpas_vfe_lite", "vfe_lite_ahb",
|
||||
"vfe_lite_csid", "vfe_lite_cphy_rx",
|
||||
"vfe_lite"},
|
||||
.clock_rate = {
|
||||
{ 0, 0, 400000000, 400000000, 0},
|
||||
{ 0, 0, 400000000, 480000000, 0}
|
||||
},
|
||||
.reg = { "csid_lite2" },
|
||||
.interrupt = { "csid_lite2" },
|
||||
.csid = {
|
||||
.is_lite = true,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
/* CSID5 (lite) */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "cpas_vfe_lite", "vfe_lite_ahb",
|
||||
"vfe_lite_csid", "vfe_lite_cphy_rx",
|
||||
"vfe_lite"},
|
||||
.clock_rate = {
|
||||
{ 0, 0, 400000000, 400000000, 0},
|
||||
{ 0, 0, 400000000, 480000000, 0}
|
||||
},
|
||||
.reg = { "csid_lite3" },
|
||||
.interrupt = { "csid_lite3" },
|
||||
.csid = {
|
||||
.is_lite = true,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
/* CSID6 (lite) */
|
||||
{
|
||||
.regulators = {},
|
||||
.clock = { "cpas_vfe_lite", "vfe_lite_ahb",
|
||||
"vfe_lite_csid", "vfe_lite_cphy_rx",
|
||||
"vfe_lite"},
|
||||
.clock_rate = {
|
||||
{ 0, 0, 400000000, 400000000, 0},
|
||||
{ 0, 0, 400000000, 480000000, 0}
|
||||
},
|
||||
.reg = { "csid_lite4" },
|
||||
.interrupt = { "csid_lite4" },
|
||||
.csid = {
|
||||
.is_lite = true,
|
||||
.hw_ops = &csid_ops_gen3,
|
||||
.parent_dev_ops = &vfe_parent_dev_ops,
|
||||
.formats = &csid_formats_gen2
|
||||
}
|
||||
},
|
||||
};
|
||||
|
||||
static const struct resources_icc icc_res_sa8775p[] = {
|
||||
{
|
||||
.name = "ahb",
|
||||
|
||||
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