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drm/amd/display: Add dcn42 register headers

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Register headers for the following IPs:
- DCN  4.2.0
- DPCS 4.0.0

Signed-off-by: Roman Li <Roman.Li@amd.com>
Acked-by: Harry Wentland <harry.wentland@amd.com>
Signed-off-by: Alex Deucher <alexander.deucher@amd.com>
This commit is contained in:
Roman Li
2026-02-02 17:11:43 -05:00
committed by Alex Deucher
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commit 2214b716a4
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drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_4_2_0_offset.h Normal file
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67277
drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_4_2_0_sh_mask.h Normal file
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142
drivers/gpu/drm/amd/include/asic_reg/dpcs/dpcs_4_0_0_offset.h Normal file
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@@ -0,0 +1,142 @@
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/* Copyright 2026 Advanced Micro Devices, Inc. */
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#endif

688
drivers/gpu/drm/amd/include/asic_reg/dpcs/dpcs_4_0_0_sh_mask.h Normal file
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@@ -0,0 +1,688 @@
/* SPDX-License-Identifier: MIT */
/* Copyright 2026 Advanced Micro Devices, Inc. */
#ifndef _dpcs_4_0_0_SH_MASK_HEADER
#define _dpcs_4_0_0_SH_MASK_HEADER
// addressBlock: dpcssys_dcio_dcio_dispdec
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//DC_GPIO_AUX_CTRL_4
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//DC_GPIO_AUX_CTRL_5
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//AUXI2C_PAD_ALL_PWR_OK
#define AUXI2C_PAD_ALL_PWR_OK__AUXI2C_PHY1_ALL_PWR_OK__SHIFT 0x0
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